kernel/drivers/gpu/drm/nouveau/nvkm/engine/fifo/dmanv50.c

   1 /*
   2  * Copyright 2012 Red Hat Inc.
   3  *
   4  * Permission is hereby granted, free of charge, to any person obtaining a
   5  * copy of this software and associated documentation files (the "Software"),
   6  * to deal in the Software without restriction, including without limitation
   7  * the rights to use, copy, modify, merge, publish, distribute, sublicense,
   8  * and/or sell copies of the Software, and to permit persons to whom the
   9  * Software is furnished to do so, subject to the following conditions:
  10  *
  11  * The above copyright notice and this permission notice shall be included in
  12  * all copies or substantial portions of the Software.
  13  *
  14  * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  15  * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  16  * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.  IN NO EVENT SHALL
  17  * THE COPYRIGHT HOLDER(S) OR AUTHOR(S) BE LIABLE FOR ANY CLAIM, DAMAGES OR
  18  * OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE,
  19  * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
  20  * OTHER DEALINGS IN THE SOFTWARE.
  21  *
  22  * Authors: Ben Skeggs
  23  */
  24 #include "channv50.h"
  25
  26 #include <core/client.h>
  27 #include <core/ramht.h>
  28
  29 #include <nvif/class.h>
  30 #include <nvif/unpack.h>
  31
  32 static int
  33 nv50_fifo_dma_new(struct nvkm_fifo *base, const struct nvkm_oclass *oclass,
  34                   void *data, u32 size, struct nvkm_object **pobject)
  35 {
  36         struct nvkm_object *parent = oclass->parent;
  37         union {
  38                 struct nv50_channel_dma_v0 v0;
  39         } *args = data;
  40         struct nv50_fifo *fifo = nv50_fifo(base);
  41         struct nv50_fifo_chan *chan;
  42         int ret;
  43
  44         nvif_ioctl(parent, "create channel dma size %d\n", size);
  45         if (nvif_unpack(args->v0, 0, 0, false)) {
  46                 nvif_ioctl(parent, "create channel dma vers %d vm %llx "
  47                                    "pushbuf %llx offset %016llx\n",
  48                            args->v0.version, args->v0.vm, args->v0.pushbuf,
  49                            args->v0.offset);
  50                 if (!args->v0.pushbuf)
  51                         return -EINVAL;
  52         } else
  53                 return ret;
  54
  55         if (!(chan = kzalloc(sizeof(*chan), GFP_KERNEL)))
  56                 return -ENOMEM;
  57         *pobject = &chan->base.object;
  58
  59         ret = nv50_fifo_chan_ctor(fifo, args->v0.vm, args->v0.pushbuf,
  60                                   oclass, chan);
  61         if (ret)
  62                 return ret;
  63
  64         args->v0.chid = chan->base.chid;
  65
  66         nvkm_kmap(chan->ramfc);
  67         nvkm_wo32(chan->ramfc, 0x08, lower_32_bits(args->v0.offset));
  68         nvkm_wo32(chan->ramfc, 0x0c, upper_32_bits(args->v0.offset));
  69         nvkm_wo32(chan->ramfc, 0x10, lower_32_bits(args->v0.offset));
  70         nvkm_wo32(chan->ramfc, 0x14, upper_32_bits(args->v0.offset));
  71         nvkm_wo32(chan->ramfc, 0x3c, 0x003f6078);
  72         nvkm_wo32(chan->ramfc, 0x44, 0x01003fff);
  73         nvkm_wo32(chan->ramfc, 0x48, chan->base.push->node->offset >> 4);
  74         nvkm_wo32(chan->ramfc, 0x4c, 0xffffffff);
  75         nvkm_wo32(chan->ramfc, 0x60, 0x7fffffff);
  76         nvkm_wo32(chan->ramfc, 0x78, 0x00000000);
  77         nvkm_wo32(chan->ramfc, 0x7c, 0x30000001);
  78         nvkm_wo32(chan->ramfc, 0x80, ((chan->ramht->bits - 9) << 27) |
  79                                      (4 << 24) /* SEARCH_FULL */ |
  80                                      (chan->ramht->gpuobj->node->offset >> 4));
  81         nvkm_done(chan->ramfc);
  82         return 0;
  83 }
  84
  85 const struct nvkm_fifo_chan_oclass
  86 nv50_fifo_dma_oclass = {
  87         .base.oclass = NV50_CHANNEL_DMA,
  88         .base.minver = 0,
  89         .base.maxver = 0,
  90         .ctor = nv50_fifo_dma_new,
  91 };